14.07.2007 | Autor / Redakteur: SearchDataCenter.de / Florian Karlstetter
Die implementierte Hardware-Virtualisierung AMD-V verfügt jetzt im Barcelona über die Technik des Rapid Virtualization Indexing oder auch Nested Paging genannt sowie Tagged TLBs.
Nested Paging übersetzt virtuelle Speicherbereiche in physikalische, ohne das Dazwischenschalten von Software beispielsweise eines Hypervisors. Der Hypervisor muss also keine Shadow Pages mehr verwalten; eine Aufgabe, die sonst ungefähr 75 Prozent seiner Zeit belegt. Die Translation wird dabei nicht im DRAM oder auf der Platte abgelegt, sondern performant im TLB (Translation Lookaside Buffer) des Gasts. AMD rechnet mit einer Verkürzung um 25 Prozent, die ein Zugriff vom Hypervisor und zurück braucht.
Der Tagged TLB erlaubt effizientes Switchen zwischen VMs, da die Tags genau angeben, welche Daten zu welcher virtuellen Maschine gehören. Der Hardware-Controller hat den Device Exclusion Vector (DEV) implementiert, der dem Hypervisor (VMM) mitteilt, ob ein Device Zugriffsrechte auf eine Speicherseite hat oder nicht. Damit erhöht sich die Sicherheit und Konflikte zwischen VMs werden vermieden.
Zu den herausragenden Neuheiten des Barcelona zählt die CoolCore-Technologie, die es ermöglicht, den Stromverbrauch des Prozessors wesentlich granularer zu steuern. Das Dual Dynamic Power Management (DDPM) sorgt dafür, dass jede Core und jeder Speichercontroller unabhängig voneinander mit unterschiedlicher Spannung je nach Leistungsanforderung betrieben werden kann. Dadurch lässt sich der Stromverbrauch sehr effizient optimieren, ein Core kann beispielsweise mit niedriger Spannung laufen, während der Speichercontroller auf voller Leistung arbeitet, um die benötigte Bandbreite zu gewährleisten.
AMD setzt zudem im Gegensatz zu Intel nicht auf Fully-buffered DIMM (FBDIMM), sondern auf die DDR2-Technologie, die einen wesentlich niedrigeren Stromverbrauch aufweist.
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